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阻抗控制目的:

為了最小化反射的負面影響，一定要有解決辦法去控制它們。本質上，有三個方法可以減輕反射的負面影響。

• 第一個方法是降低系統頻率以便在另一個信號加到傳輸線上之前傳輸線的反射達到穩態，這個對于高速系統通常是不可能的，因為它需要降低操作頻率，成為低速系統。

• 第二個方法縮短PC B走線以便反射在短時間達到穩態，這也是不實際的因為通常這樣做會增加PC B板層，成本提高很多。此外縮短走線在某種情況下在物理上也是不可能的。

• 第三個方法就是在傳輸線的兩端用等于線的特征阻抗的阻抗端接傳輸線以排除反射。

阻抗控制目的:

控制信號傳輸路徑特征阻抗保持恒定，反射系數為0，意味著傳輸路徑上沒有反射，這種情況就稱為阻抗匹配。此時信號將理想地傳遞到終端。

PCB跡線阻抗控制:

組件自身可以顯示特性阻抗，因此必須選擇PC B跡線阻抗來匹配使用中的所有邏輯系列的特性阻抗（對于 CMOS 和TTL，特性阻抗的范圍是 50 到 110 歐姆）。為了最好地將信號從源傳送到負載，跡線阻抗必須匹配發送設備的輸出阻抗和接收設備的輸入阻抗。

如果連接兩個設備的的 PCB 跡線的阻抗不匹配設備的特性阻抗，在負載設備可以進入新的邏輯狀態之前將會發生多次反射。結果將可能導致高速數字系統中的切換時間或隨機錯誤增加。為此線路設計工程師和 PCB 設計廠商必須仔細指定跡線阻抗值及其誤差。

所以阻抗控制技術在高速PCB設計中顯得尤其重要。阻抗控制技術包括兩個含義：①阻抗控制的PCB信號線是指沿高速PCB信號線各處阻抗連續，也就是說同一個網絡上阻抗是一個常數。②阻抗控制的PCB板是指PCB板上所有網絡的阻抗都控制在一定的范圍以內如20~75Ω。線路板成為“可控阻抗板”的關鍵是使所有線路的特性阻抗滿足一個規定值，通常在25歐姆和70歐姆之間。

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