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Altium Designer中關(guān)于繞等長(zhǎng)線的技巧分享

時(shí)間2015/03/07
人物Levi
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1、為什么要等長(zhǎng),等長(zhǎng)的重要性。

在 PCB 設(shè)計(jì)中,等長(zhǎng)走線主要是針對(duì)一些高速的并行總線來(lái)講的。由于這類并行總線往往有多根數(shù)據(jù)信號(hào)基于同一個(gè)時(shí)鐘采樣,每個(gè)時(shí)鐘周期可能要采樣兩次(DDR SDRAM)甚至 4 次,而隨著芯片運(yùn)行頻率的提高,信號(hào)傳輸延遲對(duì)時(shí)序的影響的比重越來(lái)越大,為了保證在數(shù)據(jù)采樣點(diǎn)(時(shí)鐘的上升沿或者下降沿)能正確采集所有信號(hào)的值,就必須對(duì)信號(hào)傳輸?shù)难舆t進(jìn)行控制。等長(zhǎng)走線的目的就是為了盡可能的減少所有相關(guān)信號(hào)在 PCB 上的傳輸延遲的差異。至于 USB/SATA/PCIE 等串行信號(hào),并沒(méi)有上述并行總線的時(shí)鐘概念,其時(shí)鐘是隱含在串行數(shù)據(jù)中的。數(shù)據(jù)發(fā)送方將時(shí)鐘包含在數(shù)據(jù)中發(fā)出,數(shù)據(jù)接收方通過(guò)接收到的數(shù)據(jù)恢復(fù)出時(shí)鐘信號(hào)。這類串行總線沒(méi)有上述并行總線等長(zhǎng)布線的概念。但因?yàn)檫@些串行信號(hào)都采用差分信號(hào),為了保證差分信號(hào)的信號(hào)質(zhì)量,對(duì)差分信號(hào)對(duì)的布線一般會(huì)要求等長(zhǎng)且按總線規(guī)范的要求進(jìn)行阻抗匹配的控制。


2、繞等長(zhǎng)的命令和技巧

方法一:
第一步:連接好需要繞等長(zhǎng)的線,。
第二步:T+R 開(kāi)始繞等長(zhǎng),TAB 鍵調(diào)出等長(zhǎng)屬性設(shè)置框,如下圖:

第三步:滑動(dòng)走蛇形線即可;
    其中“<”和“>”可以分別調(diào)整蛇形線的上下幅度,數(shù)字鍵 1 減小拐角幅度,數(shù)字鍵 2 增大拐角幅度、數(shù)字鍵 3 減小 Gap 間距、數(shù)字鍵 4 增大 Gap 間距:

方法二:Shift+A 可以直接在走線模式下饒點(diǎn)對(duì)點(diǎn)等長(zhǎng)。設(shè)置屬性和方法一相同。


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